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大型处理器的低能耗特性与设计要求分析

电子设计 ? 2019-01-22 08:28 ? 次阅读

随着更多功能被推向更小但更复杂的设备,低功耗已成为一个不可避免的大问题。特别是,具有限制性能源(例如电池电量)和紧凑空间限制的手持产品的设计转化为必须从有限的能量储备中挤出更多的运行时间。尽管如此,大型处理器被指示处理许多独立的基于I/O的任务,同时将大部分时间用于低功耗空闲和睡眠状态。由于电池运行时间是用户敏感的功能,因此工程师实时管理能量的能力可能决定了设计的成功。然而,物理学是物理学,我们只有很多选择。幸运的是,巧妙地使用我们所拥有的选项和资源仍然可以产生令人满意的结果。

本文着眼于几个具有低能耗特性和目标设计要求能效的大型处理器。它研究了降低功耗的娱乐城白菜论坛,如何动态管理外设以及这些部件能够声称和实现的能量和电流抽取数量。虽然微控制器引脚数从5到500不等,但我选择了各自系列中的所有100引脚器件,以便进行更多的比较。原理和娱乐城白菜论坛适用于更大的引脚数,因此可以推断出此处提供的信息。这里引用的所有零件,数据表,应用笔记和开发套件都可以在Digi-Key的网站上找到。

有用的设计娱乐城白菜论坛

欧姆定律和电路理论非常清楚,我们只能做很多事情。降低能耗,尤其是电路尺寸越来越小,门数越来越大。降低功率的主要方法是降低电压,这是常见的做法。通过分离式电源(内核,I/O和外设特定电源需求),片上稳压器或采用单个均匀低电压(主要为1.6至1.8 V),微控制器的功耗要求一直在稳步下降。这是芯片制造商所做的事情,如果我们选择这样做,我们所拥有的几乎所有东西都可以在更低的电压下运行。降低功耗的另一个关键方法是降低驱动我们的核心处理器逻辑的开关频率,状态机,定序器和外围设备。数字电路的功耗与它们开关或时钟的频率成正比(图1),因此降低的时钟频率会以相应的方式降低功耗。

大型处理器的低能耗特性与设计要求分析

图1:特别是对于CMOS电路,功耗与栅极级的开关频率成正比。在较低频率下获得相同的性能会大大降低功耗。

虽然这种娱乐城白菜论坛会直接降低处理性能,但并非一切都必须具有较低的时钟频率。核心处理器可能正在高速运行,但UART没有理由需要将11.0592 MHz时钟分频以获得可靠的9,600波特连接。如果芯片制造商很聪明,他们会让工程师选择如何使用我们的可用时钟来驱动我们的外围设备。有些人这样做,因此您可以从32.768 kHz频率(1个时钟,每秒3,375个)运行低能量UART。对于A/D和D/A转换器也是如此,因此基于传感器的设计也可以从这种娱乐城白菜论坛中受益。

原始处理器性能也很重要。如果起动处理器能够在必须重新进入休眠状态之前的1 ms内完成所有相关任务,则最好比必须运行20 ms的较慢处理器更好。睡眠和低功耗模式通常非常有效,因此更快进入睡眠模式可以节省大量能量。同样,唤醒时间也很重要。唤醒时能量消耗更高,因此快速唤醒意味着更少的整体更高功率导通时间。外围唤醒时间在这里也非常重要,包括芯片外和芯片外另一种降低能耗的娱乐城白菜论坛是使用片上或片外自主外设,可以在低功耗后台模式下工作,而无需主处理器的任何干预。视频或显示处理器可以刷新显示而无需处理器干预。它还可以监控触摸屏并识别真实意图与错误联系。它应该使用比核心处理器更少的功率运行,因为它通常是运行时精简,分解,减少状态的机器,需要最少量的有源硬件。

数据转换器是可以从这种娱乐城白菜论坛中受益的另一部分(图2)。每毫秒需要监视的传感器可以在计时器启动转换时休眠,将转换结果传输到内存,更新指针和计数器,并且只有在准备好处理一定数量的样本时才唤醒处理器。添加比较(作为模拟比较器或数字值阈值监视器)可用于使处理器无限期地保持睡眠状态,直到出现“警报”或“警报”级别。这样就可以节省所有唤醒,嗅探和恢复睡眠的能量。

图2:可以监视顺序进程的自治状态机可以使内核保持深度睡眠状态以便延长周期,节省大量的电力使用。

在我们的示例微观中仔细检查的一个关键参数是他们声称实现的实际待机电流。虽然这些都是很好的球场数据,可以帮助缩小场地范围,但是要考虑到这些数字,因为许多其他因素会影响整体功耗。例如,我们的I/O状态是什么时候微睡觉?这些功耗数字不包含在供应商使用的任何低功耗数字中,因为它们取决于我们如何配置I/O.如果我们驱动两个20 mA高电流I/O线,并且我们的睡眠电流为100μA,我们仍然在静态和睡眠状态下燃烧40.1 mA。

一些好的候选者

几家MCU制造商低能耗和低功耗能力,我们有责任了解我们可以相信什么和不能相信什么。确定这些数字的方式比手头的数字更重要。尽管如此,在寻找满足我们性能需求且可以在低功耗模式下运行的处理器时,已发布的规格和功能是一个很好的起点。例如,采用Atmel的SAM4Lx系列ARM?Cortex?-M4处理器其专有的picoPower娱乐城白菜论坛。该48 MHz器件的有功电流消耗低至90μA/MHz。它宣称其快速的1.5μs唤醒时间,这是一个重要的数字。此外,其等待和保持模式下,RAM保持的低功耗模式分别降至3和1.5μA。请注意Atmel用于RTC和器件的低功耗32.768 kHz时钟。还可以接入慢速R/C时钟以进一步降低功耗。对于USB高速数据的突发,内部PLL可以高达240 MHz,然后再次关闭以节省功耗。 100引脚ATSAM4LC2CA-AU具有80个I/O,其中包括6个高驱动电流吸收源引脚,输入电压低至1.68 V.该器件仅消耗218μA/MHz(最高48 MHz),同时在低功耗模式下消耗6.9μA。

SAM4L内部一个有趣的功能块是产生时钟和复位的电源管理模块,并执行 - CPU,高速总线和外围总线时钟的频率变化(图3)。屏蔽寄存器保持时钟的分频器电平,允许所有器件以不同的速度运行以节省功耗。此外,当发生即时频率变化并且未使用的外设可以完全关闭时钟时,不需要关闭外设或功能模块。

大型处理器的低能耗特性与设计要求分析

图3:CPU,总线和外设的动态时钟更改通过专用的电源管理单元进行控制,该单元也可以将时钟完全关闭到未使用的外设。 br》此处还嵌入了其他几种功率优化外设和功能,包括胶合逻辑控制器,并行捕获模式,带窗口检测的模拟比较器,以及独立的外设事件检测系统,可实现直接的外设到外设通信保持核心睡眠。

在可比较的规模上,让我们看一下STMicroelectronics的-L1系列。该部件采用超低泄漏工艺娱乐城白菜论坛,功耗低。特别是,我们将研究STM32L151VBT6,它是具有83个I/O的100引脚版本。该器件的工作电压低至1.65 V,工作频率范围为32 kHz至32 MHz,频率为214μA/MHz。虽然它的唤醒时间《8μs并不像某些那么快,但它确实具有9μA的低功耗运行模式。这里的一些不错的功能包括两个超低功耗比较器和低功耗12-位A/D和D/A转换器,速率高达1 Msample/s(当VCC为2.4 V或更高时)。一个不错的“ZEROPOWER”上电复位可以与掉电复位电路紧密耦合,许多睡眠,贪睡和低功耗模式提供了一些灵活性,可以在核心和其他外设睡眠时保持某些外设处于活动状态。该器件还具有32.768 kHz时钟和相当灵活的时钟分配方案。

德州仪器TI)的一款有趣的低功耗产品值得关注。众所周知的MSP430系列有几个部件经过优化,可以降低能耗,例如100引脚MSP430F5436IPZR。虽然最低工作电压仅为2.2 V,但它是一个16位内部架构(本质上可以通过不必保持这样的宽寄存器来节省能量),并且在待机模式下仅有1.8μA的RAM保留。

其低功耗存储器的唤醒时间为5μs,电流消耗为226μA/MHz。该器件还提供低功耗振荡器,最高可达18 MHz。 MSP430系列包括针对特定应用组合各种外设的成员。不同的风格包括12位A/D转换器,内部参考,采样和保持以及自动扫描功能。

提供一种有源模式,但提供五种软件可选的低功耗模式,保持不同的功能和外设活。所有I/O端口的驱动强度都是可编程的,可以定义多达10个8位I/O端口,以便于并行接口。

Digi-Key网站上的TI提供超低功耗MSP430培训模块对于MSP430,以及其他几个描述外设,设计工具,时钟系统等的产品培训模块。

Silicon Labs提供了一个有趣且有效的低功耗处理器解决方案,其48 MHz Giant Gecko ARM 32位Cortex -M3,100引脚(86 I/O)处理器 - EFM32GG280F1024-QFP100。这部分以及Gecko部件系列的其他部件从头开始设计,具有低能量外设(低能量UART,A/D,D/A等),快速唤醒(2μs),自主外设和嵌入式硬件,以促进可延长电池运行时间的低能耗模式。

在全功率模式下,一切都打开并运行,该器件提供150μA/MHz的极低功耗。其他四种低功耗和睡眠模式使选择的外设和RAM保持活动状态。此外,与同类产品中的其他几款处理器一样,Geckos采用灵活的时钟方案,同时具有高频和低频晶振以及R/C振荡器,可以为不同的时钟提供时钟和功率优化。

Gecko MCU使用公司在部件内部称为反射总线的方式将自主功能提升到更高水平。这是一种基于状态机的互连机制,类似于将指挥棒从一个外围设备传递到另一个外围设备,同时微睡眠。供应商的LESENSE功能可以设计具有自主条件监控功能的超低功耗传感器接口。在不使用微控制器CPU的情况下,EFM32系列可以监控16个传感器并做出反应,同时将能耗降至最低。 LESENSE低功耗传感器接口还支持片上模拟比较器,运算放大器和非常方便的事件检测器。这允许复杂的事件链在低功率背景状态下发生而无需唤醒核心处理器(图4)。

大型处理器的低能耗特性与设计要求分析

图4:组合几个低能量这个例子说明了一个使用霍尔效应器件的正交金属传感器,它不会唤醒处理器,直到进行了一些相当高级别的决策。振荡器的频率和幅度会有所不同,具体取决于金属的存在。一旦有偏见,巧妙使用事件检测器将告诉工程师我们正在寻找的事件已经发生。然后我们唤醒我们的处理器。

Silicon Labs引用的另一个应用示例是一个自振荡电容式触摸屏传感器,它只在有效触摸发生时唤醒主机处理器。以类似的方式,可以在核心休眠时监控传感器,并且仅在报警条件下唤醒传感器。

更少可以更多

低能耗设计的最佳方法,尤其是大量I/O,硬件功能,资源和巧妙的编码设计方法的组合。而不是FOR或WHILE循环,让微睡眠和从定时器或事件唤醒它可以节省电力。

同样,能够在每个I/O上编程驱动器强度,甚至禁用内部上拉所以你可以使用更高价值的外部能量,有助于从你的能源中挤出每一微焦耳的能量。很高兴知道这些部件随时可以提供帮助,提供各种低能耗功能。

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的头像 MCA手机联盟 发表于 01-28 15:58 ? 1337次 阅读
小米真冲击高端市场真的能成吗?脱去性价比标签不是那么容易

Bose noise-masking sleepbuds? 遮噪睡眠耳塞正式在国内上市

Bose noise-masking sleepbuds? 遮噪睡眠耳塞遮噪睡眠耳塞预先加载了10种....
的头像 BOSE官方 发表于 01-28 15:30 ? 762次 阅读
Bose noise-masking sleepbuds? 遮噪睡眠耳塞正式在国内上市

图解电动车的三大安全问题

车辆/电池的安全,是打算购买电动车的消费者关注的首要问题。在腾势娱乐城白菜论坛公开课上,工程师讲解了目前市场关....
的头像 锂电联盟会长 发表于 01-28 14:21 ? 784次 阅读
图解电动车的三大安全问题

AM5749 Sitara 处理器:双核 Arm Cortex-A15 和双核 DSP,多媒体、支持 ECC 的 DDR、安全引导和深度学习

AM574x Sitara Arm应用处理器旨在满足现代嵌入式产品的强烈处理需求。 AM574x器件通过以下方式实现高处理性能完全集成的混合处理器解决方案的最大灵活性。这些器件还将可编程视频处理与高度集成的外设集合在一起。每个AM574x器件都提供加密加速。 可编程性由具有Neon?扩展的双核Arm Cortex-A15 RISC CPU和两个TI C66x VLIW浮点DSP内核提供。 Arm允许开发人员将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm和C66x提供了一整套开发工具。 DSP,包括C编译器,用于简化编程和调度的DSP汇编优化器,以及用于查看源代码执行情况的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS器件的更多信息,请联系您的TI代表。 AM574x Sitara Arm应用处理器旨在满足现代嵌入式产品的强烈处理需求。 AM574x器件通过提供高处理性能完全集成的混合处理器解决方案的最大灵活性这些器件还将可编程视频处理与高度集成的外围设备相结合。每个AM574x器件都提供加密加速...
发表于 01-08 17:50 ? 24次 阅读
AM5749 Sitara 处理器:双核 Arm Cortex-A15 和双核 DSP,多媒体、支持 ECC 的 DDR、安全引导和深度学习

AM6528 Sitara 处理器:双核 Arm Cortex-A53 和双核 Arm Cortex-R5F,千兆位 PRU-ICSS,3D 图形

AM654x和AM652x Sitara Arm应用处理器旨在满足现代工业嵌入式产品的复杂处理需求。 AM654x和AM652x将四个或两个Arm Cortex-A53内核与双核Cortex-R5F MCU子系统(该子系统具有旨在帮助客户实现他们最终产品的功能安全目标的特性)和三个千兆位工业通信子系统(PRU_ICSSG) )组合在一起,从而为功能安全应用打造出支持.AM65xx目前正在按照IEC 61508标准要求,接受T?V南德意志集团的认证评估。 四个A53内核分布在两个具有共享L2存储器的双核集群中,以创建两个处理通道。片上存储器,外设和互联中包含广泛的ECC,可确保可靠性。整个SoC中包含旨在帮助客户设计可实现他们的功能安全目标的特性(正在等待T?V南德评估结果)。除了DMSC管理的粒度防火墙之外,AM654x和AM652x 四核Arm Cortex-A53 RISC CPU及霓虹扩展可实现可编程性,而双核Cortex-R5F MCU子系统可作为两个内核用在一般用途或用于锁步模式,以帮助满足功能安全应用的需求.PRU_ICSSG子系统可用于提供最多六个工业以太网端口,如Profinet IRT,TSN或EtherCAT?等,或者用于标准千兆位以太网连接。 TI提供了一整套...
发表于 01-08 17:50 ? 39次 阅读
AM6528 Sitara 处理器:双核 Arm Cortex-A53 和双核 Arm Cortex-R5F,千兆位 PRU-ICSS,3D 图形

AM6546 Sitara 处理器:四核 Arm Cortex-A53 和双核 Arm Cortex-R5F,千兆位 PRU-ICSS

AM654x和AM652x Sitara Arm应用处理器旨在满足现代工业嵌入式产品的复杂处理需求。 AM654x和AM652x将四个或两个Arm Cortex-A53内核与双核Cortex-R5F MCU子系统(该子系统具有旨在帮助客户实现他们最终产品的功能安全目标的特性)和三个千兆位工业通信子系统(PRU_ICSSG) )组合在一起,从而为功能安全应用打造出支持.AM65xx目前正在按照IEC 61508标准要求,接受T?V南德意志集团的认证评估。 四个A53内核分布在两个具有共享L2存储器的双核集群中,以创建两个处理通道。片上存储器,外设和互联中包含广泛的ECC,可确保可靠性。整个SoC中包含旨在帮助客户设计可实现他们的功能安全目标的特性(正在等待T?V南德评估结果)。除了DMSC管理的粒度防火墙之外,AM654x和AM652x 四核Arm Cortex-A53 RISC CPU及霓虹扩展可实现可编程性,而双核Cortex-R5F MCU子系统可作为两个内核用在一般用途或用于锁步模式,以帮助满足功能安全应用的需求.PRU_ICSSG子系统可用于提供最多六个工业以太网端口,如Profinet IRT,TSN或EtherCAT?等,或者用于标准千兆位以太网连接。 TI提供了一整套...
发表于 01-08 17:50 ? 36次 阅读
AM6546 Sitara 处理器:四核 Arm Cortex-A53 和双核 Arm Cortex-R5F,千兆位 PRU-ICSS

AM6527 Sitara 处理器:双核隔离式 Arm Cortex-A53 和双核 Arm Cortex-R5F,千兆位 PRU-ICSS

AM654x和AM652x Sitara Arm应用处理器旨在满足现代工业嵌入式产品的复杂处理需求。 AM654x和AM652x将四个或两个Arm Cortex-A53内核与双核Cortex-R5F MCU子系统(该子系统具有旨在帮助客户实现他们最终产品的功能安全目标的特性)和三个千兆位工业通信子系统(PRU_ICSSG) )组合在一起,从而为功能安全应用打造出支持.AM65xx目前正在按照IEC 61508标准要求,接受T?V南德意志集团的认证评估。 四个A53内核分布在两个具有共享L2存储器的双核集群中,以创建两个处理通道。片上存储器,外设和互联中包含广泛的ECC,可确保可靠性。整个SoC中包含旨在帮助客户设计可实现他们的功能安全目标的特性(正在等待T?V南德评估结果)。除了DMSC管理的粒度防火墙之外,AM654x和AM652x 四核Arm Cortex-A53 RISC CPU及霓虹扩展可实现可编程性,而双核Cortex-R5F MCU子系统可作为两个内核用在一般用途或用于锁步模式,以帮助满足功能安全应用的需求.PRU_ICSSG子系统可用于提供最多六个工业以太网端口,如Profinet IRT,TSN或EtherCAT?等,或者用于标准千兆位以太网连接。 TI提供了一整套...
发表于 01-08 17:50 ? 42次 阅读
AM6527 Sitara 处理器:双核隔离式 Arm Cortex-A53 和双核 Arm Cortex-R5F,千兆位 PRU-ICSS

AM6548 Sitara 处理器:四核 Arm Cortex-A53 和双核 Arm Cortex-R5F,千兆位 PRU-ICSS,3D 图形

AM654x和AM652x Sitara Arm应用处理器旨在满足现代工业嵌入式产品的复杂处理需求。 AM654x和AM652x将四个或两个Arm Cortex-A53内核与双核Cortex-R5F MCU子系统(该子系统具有旨在帮助客户实现他们最终产品的功能安全目标的特性)和三个千兆位工业通信子系统(PRU_ICSSG) )组合在一起,从而为功能安全应用打造出支持.AM65xx目前正在按照IEC 61508标准要求,接受T?V南德意志集团的认证评估。 四个A53内核分布在两个具有共享L2存储器的双核集群中,以创建两个处理通道。片上存储器,外设和互联中包含广泛的ECC,可确保可靠性。整个SoC中包含旨在帮助客户设计可实现他们的功能安全目标的特性(正在等待T?V南德评估结果)。除了DMSC管理的粒度防火墙之外,AM654x和AM652x 四核Arm Cortex-A53 RISC CPU及霓虹扩展可实现可编程性,而双核Cortex-R5F MCU子系统可作为两个内核用在一般用途或用于锁步模式,以帮助满足功能安全应用的需求.PRU_ICSSG子系统可用于提供最多六个工业以太网端口,如Profinet IRT,TSN或EtherCAT?等,或者用于标准千兆位以太网连接。 TI提供了一整套...
发表于 01-08 17:49 ? 81次 阅读
AM6548 Sitara 处理器:四核 Arm Cortex-A53 和双核 Arm Cortex-R5F,千兆位 PRU-ICSS,3D 图形

AM6526 Sitara 处理器:双核 Arm Cortex-A53 和双核 Arm Cortex-R5F,千兆位 PRU-ICSS

AM654x和AM652x Sitara Arm应用处理器旨在满足现代工业嵌入式产品的复杂处理需求。 AM654x和AM652x将四个或两个Arm Cortex-A53内核与双核Cortex-R5F MCU子系统(该子系统具有旨在帮助客户实现他们最终产品的功能安全目标的特性)和三个千兆位工业通信子系统(PRU_ICSSG) )组合在一起,从而为功能安全应用打造出支持.AM65xx目前正在按照IEC 61508标准要求,接受T?V南德意志集团的认证评估。 四个A53内核分布在两个具有共享L2存储器的双核集群中,以创建两个处理通道。片上存储器,外设和互联中包含广泛的ECC,可确保可靠性。整个SoC中包含旨在帮助客户设计可实现他们的功能安全目标的特性(正在等待T?V南德评估结果)。除了DMSC管理的粒度防火墙之外,AM654x和AM652x 四核Arm Cortex-A53 RISC CPU及霓虹扩展可实现可编程性,而双核Cortex-R5F MCU子系统可作为两个内核用在一般用途或用于锁步模式,以帮助满足功能安全应用的需求.PRU_ICSSG子系统可用于提供最多六个工业以太网端口,如Profinet IRT,TSN或EtherCAT?等,或者用于标准千兆位以太网连接。 TI提供了一整套...
发表于 01-08 17:48 ? 22次 阅读
AM6526 Sitara 处理器:双核 Arm Cortex-A53 和双核 Arm Cortex-R5F,千兆位 PRU-ICSS

DRA793 适用于音频放大器且带 DSP 的 500MHz ARM Cortex-A15 SoC 处理器

DRA79x处理器提供538球,17×17毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel?阵列(VCA)娱乐城白菜论坛,球栅阵列(BGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 可编程性由具有Neon?扩展的单核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核提供。 Arm处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS设备的更多信息,请联系您的TI代表。 DRA79x Jacinto 6 RSP(无线电声音处理器)设备系列符合AEC-Q100标准。 设备具有简化的电源...
发表于 11-02 19:27 ? 21次 阅读
DRA793 适用于音频放大器且带 DSP 的 500MHz ARM Cortex-A15 SoC 处理器

DRA750 适用于信息娱乐应用的双 1.0GHz A15、双 DSP、扩展外设 SoC 处理器

DRA75x和DRA74x(Jacinto 6)信息娱乐应用处理器旨在满足现代信息娱乐系统汽车体验的强烈处理需求。
发表于 11-02 19:27 ? 17次 阅读
DRA750 适用于信息娱乐应用的双 1.0GHz A15、双 DSP、扩展外设 SoC 处理器

DRA725 适用于汽车信息娱乐系统的 SoC 处理器

DRA72x(“Jacinto 6 Eco”)信息娱乐应用处理器采用与Jacinto 6设备相同的架构开发,以满足现代信息娱乐系统的强烈处理需求 - DRA72x器件为DRA74x器件提供了向上的可扩展性,同时在整个系列中引脚兼容,允许原始设备制造商(OEM)和原始设计制造商(ODM)快速实现创新连接娱乐城白菜论坛,语音识别,音频流等。 Jacinto 6和Jacinto 6 Eco设备通过完全集成的混合处理器解决方案的最大灵活性带来高处理性能。 可编程性由具有Neon?扩展和TI C66x VLIW浮点DSP内核的单核ARM Cortex-A15 RISC CPU提供。 ARM处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为ARM提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行情况的调试接口。 DRA72x Jacinto 6 Eco处理器系列符合AEC-Q100标准。 特性 为信息娱乐应用而设计的架构 视频,图像和图形处理支持 全高清视频(1920×1080p,60 fps) 多视频输入和视频输出 2D和3D图形 ARM < sup>? Cortex ? -A15微处理器子系统 C66x浮点VLIW DSP 完全对象代码与C67x和...
发表于 11-02 19:27 ? 62次 阅读
DRA725 适用于汽车信息娱乐系统的 SoC 处理器

DRA714 适用于信息娱乐系统和仪表组且带图形和数字信号处理器的 600MHz ARM Cortex-A15 SoC 处理器

DRA71x处理器提供538球,17×17毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel?阵列(VCA)娱乐城白菜论坛,球栅阵列(BGA)封装。 该架构旨在通过经济高效的解决方案为汽车应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”),DRA74x“Jacinto”提供全面的可扩展性6“和DRA72x”Jacinto 6 Eco“系列信息娱乐处理器,包括图形,语音,HMI,多媒体和智能手机投影模式功能。 可编程性由具有Neon?扩展的单核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核提供。 Arm处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS器件的更多信息,请联系您的TI代表。 DRA71x Jacinto 6入口处理器系列符合AEC-Q100标准。 该器件具有简化的电源轨道映射可实现更低成本的P...
发表于 11-02 19:27 ? 57次 阅读
DRA714 适用于信息娱乐系统和仪表组且带图形和数字信号处理器的 600MHz ARM Cortex-A15 SoC 处理器

DRA716 适用于信息娱乐系统和仪表组且带图形和数字信号处理器的 800MHz ARM Cortex-A15 SoC 处理器

DRA71x处理器提供538球,17×17毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel?阵列(VCA)娱乐城白菜论坛,球栅阵列(BGA)封装。 该架构旨在通过经济高效的解决方案为汽车应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”),DRA74x“Jacinto”提供全面的可扩展性6“和DRA72x”Jacinto 6 Eco“系列信息娱乐处理器,包括图形,语音,HMI,多媒体和智能手机投影模式功能。 可编程性由具有Neon?扩展的单核Arm Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核提供。 Arm处理器使开发人员能够将控制功能与DSP和协处理器上编程的其他算法分开,从而降低系统软件的复杂性。 此外,TI还为Arm提供了一整套开发工具, DSP,包括C编译器和用于查看源代码执行的调试接口。 所有设备都提供加密加速。高安全性(HS)设备上提供了所有其他受支持的安全功能,包括对安全启动,调试安全性和对可信执行环境的支持的支持。有关HS器件的更多信息,请联系您的TI代表。 DRA71x Jacinto 6入口处理器系列符合AEC-Q100标准。 该器件具有简化的电源轨道映射可实现更低成本的P...
发表于 11-02 19:27 ? 66次 阅读
DRA716 适用于信息娱乐系统和仪表组且带图形和数字信号处理器的 800MHz ARM Cortex-A15 SoC 处理器

DRA782 适用于音频放大器且带双核 DSP 的 SoC 处理器

DRA78x处理器提供367球,15×15毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel?阵列(VCA)娱乐城白菜论坛,球栅阵列(S-PBGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 此外,TI还为Arm和DSP提供了一整套开发工具,包括C编译器和用于查看源代码执行情况的调试接口。 DRA78x Jacinto 6 RSP (无线电声音处理器)器件系列符合AEC-Q100标准。 该器件具有简化的电源轨映射,可实现低成本的PMIC解决方案。 DRA78x处理器采用Via Channel?阵列(VCA)娱乐城白菜论坛,球栅阵列(S-PBGA)封装,提供367球,15×15 mm,0.65 mm球间距(0.8 mms间距规则可用于信号)。 该架构旨在通过经济高效的解决方案为汽车处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可扩展性“),DRA74x”Jacinto 6“,...
发表于 11-02 19:27 ? 19次 阅读
DRA782 适用于音频放大器且带双核 DSP 的 SoC 处理器

TDA3MA 具有完备的处理和视觉加速功能且适用于 ADAS 应用的低功耗 SoC

TI的TDA3x片上系统(SoC)是经过高度优化的可扩展系列器件,其设计满足领先的高级驾驶员辅助系统(ADAS)要求.TDA3x系列集最佳性能,低功耗特性和更小的外形尺寸和ADAS视觉分析处理功能于一体,有助于实现更自主的无碰撞驾驶体验,从而在汽车领域中的ADAS应用中得到了广泛的应用。 TDA3x SoC基于单一架构支持行业最广泛的ADAS应用(包括前置摄像头,后置摄像头,环视,雷达和融合娱乐城白菜论坛),在当今汽车领域实现了复杂的嵌入TMS3x SoC采用异类可扩展架构,包含TI的定点和浮点TMS320C66x数字信号处理器(DSP)生成内核,Vision AccelerationPac(EVE)和Cortex-M4双核处理器。视觉娱乐城白菜论坛。 TDA3x SoC采用异类可扩展架构。该器件可采用不同的封装选项(包括叠加封装)实现小外形尺寸设计,从而实现低功耗配置.TDA3x SoC还集成有诸多外设,包括LVDS环视系统的多摄像头接口(并行和串行),显示屏,控制器局域网(CAN)和千兆位以太网视频桥接(AVB)。 适用于本系列产品的Vision AccelerationPac包含嵌入式视觉引擎(EVE),因此应用处理器不用再执行视觉分析功能,同时还降低了能耗。视觉...
发表于 11-02 19:27 ? 23次 阅读
TDA3MA 具有完备的处理和视觉加速功能且适用于 ADAS 应用的低功耗 SoC

DRA781 适用于音频放大器且带 DSP 的 SoC 处理器

DRA78x处理器提供367球,15×15毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel?阵列(VCA)娱乐城白菜论坛,球栅阵列(S-PBGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 此外,TI还为Arm和DSP提供了一整套开发工具,包括C编译器和用于查看源代码执行情况的调试接口。 DRA78x Jacinto 6 RSP (无线电声音处理器)器件系列符合AEC-Q100标准。 该器件具有简化的电源轨映射,可实现低成本的PMIC解决方案。 DRA78x处理器采用Via Channel?阵列(VCA)娱乐城白菜论坛,球栅阵列(S-PBGA)封装,提供367球,15×15 mm,0.65 mm球间距(0.8 mms间距规则可用于信号)。 该架构旨在通过经济高效的解决方案为汽车处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可扩展性“),DRA74x”Jacinto 6“,...
发表于 11-02 19:27 ? 42次 阅读
DRA781 适用于音频放大器且带 DSP 的 SoC 处理器

TDA3LX 适用于 ADAS 应用且具有处理、成像与视觉加速功能的低功耗 SoC

TI的TDA3x片上系统(SoC)是经过高度优化的可扩展系列器件,其设计满足领先的高级驾驶员辅助系统(ADAS)要求.TDA3x系列集最佳性能,低功耗特性和更小的外形尺寸和ADAS视觉分析处理功能于一体,有助于实现更自主的无碰撞驾驶体验,从而在汽车领域中的ADAS应用中得到了广泛的应用。 TDA3x SoC基于单一架构支持行业最广泛的ADAS应用(包括前置摄像头,后置摄像头,环视,雷达和融合娱乐城白菜论坛),在当今汽车领域实现了复杂的嵌入TMS3x SoC采用异类可扩展架构,包含TI的定点和浮点TMS320C66x数字信号处理器(DSP)生成内核,Vision AccelerationPac(EVE)和Cortex-M4双核处理器。视觉娱乐城白菜论坛。 TDA3x SoC采用异类可扩展架构。该器件可采用不同的封装选项(包括叠加封装)实现小外形尺寸设计,从而实现低功耗配置.TDA3x SoC还集成有诸多外设,包括LVDS环视系统的多摄像头接口(并行和串行),显示屏,控制器局域网(CAN)和千兆位以太网视频桥接(AVB)。 适用于本系列产品的Vision AccelerationPac包含嵌入式视觉引擎(EVE),因此应用处理器不用再执行视觉分析功能,同时还降低了能耗。视觉...
发表于 11-02 19:27 ? 20次 阅读
TDA3LX 适用于 ADAS 应用且具有处理、成像与视觉加速功能的低功耗 SoC

DRA786 适用于音频放大器且带双核 DSP 和 EVE 的 SoC 处理器

DRA78x处理器提供367球,15×15毫米,0.65毫米球间距(0.8毫米间距规则可用于信号)采用Via Channel?阵列(VCA)娱乐城白菜论坛,球栅阵列(S-PBGA)封装。 该架构旨在通过经济高效的解决方案为汽车协处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto”提供全面的可扩展性6 Ex“),DRA74x”Jacinto 6“,DRA72x”Jacinto 6 Eco“和DRA71x”Jacinto 6 Entry“系列信息娱乐处理器。 此外,TI还为Arm和DSP提供了一整套开发工具,包括C编译器和用于查看源代码执行情况的调试接口。 DRA78x Jacinto 6 RSP (无线电声音处理器)器件系列符合AEC-Q100标准。 该器件具有简化的电源轨映射,可实现低成本的PMIC解决方案。 DRA78x处理器采用Via Channel?阵列(VCA)娱乐城白菜论坛,球栅阵列(S-PBGA)封装,提供367球,15×15 mm,0.65 mm球间距(0.8 mms间距规则可用于信号)。 该架构旨在通过经济高效的解决方案为汽车处理器,混合无线电和放大器应用提供高性能并发,从DRA75x(“Jacinto 6 EP”和“Jacinto 6 Ex”提供完全可扩展性“),DRA74x”Jacinto 6“,...
发表于 11-02 19:27 ? 51次 阅读
DRA786 适用于音频放大器且带双核 DSP 和 EVE 的 SoC 处理器

DRA756 Jacinto 汽车电子应用处理器

DRA75x和DRA74x(Jacinto 6)信息娱乐应用处理器旨在满足现代信息娱乐系统汽车体验的强烈处理需求。 最多两个嵌入式视觉引擎(EVE) IVA子系统 显示子系统 使用DMA引擎显示控制器,最多三个管道 HDMI?编码器:符合HDMI 1.4a和DVI 1.0 视频处理引擎(VPE) 2D-Graphics加速器(BB2D)子系统 Vivante ? GC320核心 双核PowerVR ? SGX544 3D GPU 三个视频输入端口(VIP)模块 支持多达10个多路复用输入端口 通用内存控制器(GPMC) 增强型直接内存访问(EDMA)控制器 2端口千兆以太网(GMAC) 十六32 -Bit通用定时器 32位MPU看门狗定时器 五个内部集成电路(I 2 C)端口 HDQ?/1-Wire ?接口 SATA接口 媒体本地总线(MLB)子系统 十个可配置UART /IrDA /CIR模块 四个多通道串行外设接口(McSPI) Quad SPI(QSPI) 八个多通道音频串行端口(McASP)模块 SUPERS peed USB 3.0双重角色设备 三个高速USB 2.0双重角色设备 四个多媒体卡/安全数字/安全数字输入输出接口(MMC?/SD ? /SDIO) PCI-Express ?...
发表于 11-02 19:27 ? 32次 阅读
DRA756 Jacinto 汽车电子应用处理器

SMJ320C6415 定点数字信号处理器

TMS320C64x ?? DSP(包括SMJ320C6414,SMJ320C6415和SMJ320C6416器件)是TMS320C6000中性能最高的定点DSP产品? DSP平台。 TMS320C64x ?? (C64x ?? )设备是基于第二代高性能,先进的VelociTI ??德州仪器(TI)开发的超长指令字(VLIW)架构(VelociTI.2 ??),使这些DSP成为多通道和多功能应用的绝佳选择。 C64x ??是C6000的代码兼容成员?? DSP平台。 C64x器件以720 MHz的时钟速率提供高达57.6亿条指令/秒(MIPS)的性能,可为高性能DSP编程挑战提供经济高效的解决方案。 C64x DSP具有高速控制器的操作灵活性和阵列处理器的数字功能。 C64x ?? DSP内核处理器有64个32位字长的通用寄存器和8个高度独立的功能单元 - 两个乘法器用于32位结果和六个算术逻辑单元(ALU)??用VelociTI.2 ??扩展。 VelociTI.2 ??八个功能单元中的扩展包括新的指令,以加速关键应用程序的性能,并扩展VelociTI的并行性?建筑。 C64x每周期可产生4个32位乘法累加(MAC),总计每秒2400万MAC(MMACS),或每周期8个8位MAC,总计4800 MMACS。 C64x DSP还具有特定于应用的硬件逻...
发表于 11-02 18:50 ? 48次 阅读
SMJ320C6415 定点数字信号处理器

AM5718-HIREL AM5718-HIREL Sitara? 处理器器件版本 2.0

AM5718-HIREL Sitara ARM应用处理器旨在满足现代嵌入式产品对于处理性能的强烈需求。 AM5718-HIREL器件通过其极具灵活性的全集成混合处理器解决方案,可实现较高的处理性能。此外,这些器件还将可编程的视频处理功能与高度集成的外设集完美融合。 采用配有Neon?扩展组件的单核ARM Cortex-A15 RISC CPU和TI C66x VLIW浮点DSP内核,可提供编程功能。借助ARM处理器,开发人员能够将控制函数与在DSP和协处理器上编程的其他算法分离开来,从而降低系统软件的复杂性。 此外,TI为ARM和C66x DSP提供了一系列完整的开发工具,其中包括C语言编译器,用在简化编程和调度的DSP汇编优化器,可查看源代码执行情况的调试界面等。 AM5718-HIREL Sitara ARM处理器系列符合AEC-Q100标准。 特性 有关器件版本1.0的详细信息,请参阅SPRS919 ARM?Cortex?-A15微处理器子系统 数字信号处理器(DSP) 目标代码与C67x和C64x +完全兼容 每周期最多32次16 x 16位定点乘法 高达512KB的片上L3 RAM 3级(L3)和4级(L4)互连 DDR3 /DDR3L存储器接口(EMIF)模块 ...
发表于 11-02 18:49 ? 35次 阅读
AM5718-HIREL AM5718-HIREL Sitara? 处理器器件版本 2.0

SM320C6457-HIREL 通信基础设施数字信号处理器

的TMS320C64x +?DSP(包括SM320C6457-HIREL器件)是TMS320C6000DSP平台上的高性能定点DSP系列产品.SM320C6457-HIREL器件基于德州仪器(TI)开发的第3代高性能,高级VelociTI超长指令字(VLIW)架构,这使得该系列DSP非常适合包括视频和电信基础设施,成像/医疗以及无线基础设施(WI)在内的各类应用。 C64x +器件向上代码兼容属于C6000?DSP平台的早期器件。 基于65nm的工艺娱乐城白菜论坛以及凭借高达96亿条指令每秒(MIPS)[或9600 16位MMAC每周期]的性能( 1.2GHz的时钟速率时),SM320C6457-HIREL器件提供了一套应对高性能DSP编程挑战的经济高效型解决方案.SM320C6457-HIREL DSP可以灵活地利用高速控制器以及阵列处理器的数值计算能力。 C64x + DSP内核采用8个功能单元,2个寄存器文件以及2个数据路径。与早期C6000器件一样,其中2个功能单为乘法器或.M单元.C64x内核每个时钟周期执行4次16位×16位乘法累加,相比之下,C64x + .M单元的乘法吞吐量可增加一倍。因此,C64x +内核每个周期可以执行8次16位×16位MAC。采用1.2GHz时钟速率时,这意味着每秒可以执行9600次1...
发表于 11-02 18:48 ? 51次 阅读
SM320C6457-HIREL 通信基础设施数字信号处理器